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RTL设计工程师
2.5-5万·14薪
人 · 本科 · 5-6年工作经验 · 性别不限2024/09/27发布
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公司信息
芯聆半导体(苏州)有限公司

合资/少于50人

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职位描述
岗位职责:
1. 根据项目需求和性能指标,进行数字电路设计、编码和验证;低速通信接口/状态机
2. 对设计的数字电路进行功能验证和性能测试,确保设计满足项目要求;
3. 根据验证结果,对数字电路进行性能优化和问题调试;
4. 与其他工程师(验证/模拟设计)协同完成芯片设计验证,并确保整个芯片的设计质量;
5. 编写数字电路设计、验证和集成相关的技术文档;时序图和状态跳转图
6. 为生产、测试和客户提供技术支持,解决回片测试过程中遇到的数字相关问题;
7. 负责芯片SDC File生成、检查和完善;
8. 负责RTL代码到Netlist的综合实现, STA时序分析,并配合PR sign off;
9. 负责与 PR交付Netlist/约束,时序迭代等。

任职资格:
1. 电子工程、集成电路设计、通信或相关专业本科及以上学历;
2. 具备扎实的数字电路设计基础,熟悉Verilog编程;了解makefile/python,熟悉数模接口设计
3. 熟悉EDA工具(如Cadence xrun、Synopsys Verdi/ spyglass等)的使用,了解ASIC设计流程;
4、熟悉时序约束的生成和检查;
5、使用Design Compiler实现模块和芯片级综合;
6、使用LEC/Formality完成等效性检查, ECO实现等;
7、使用 PT完成STA分析和时序收敛;
8、熟悉综合中的scan insertion、UPF低功耗等相关流程和技术;
9、熟悉unix操作,运用perl、cshell、tcl实现流程自动化;
10. 具备良好的逻辑思维能力和分析问题的能力;
11. 良好的团队协作精神和沟通能力,能承受一定的工作压力;
12. 了解中后端概念、基本流程、PR工具使用等经验优先。
备注:该岗位也可以base苏州

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