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数字前端设计工程师
1-2万·14薪
人 · 本科 · 1年工作经验 · 性别不限2024/09/19发布
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合肥创新产业园-J1栋
公司信息
江苏华存电子科技有限公司

民营/50-150人
该公司所有职位
职位描述
经验 (专业技能)
1. 精通Verilog RTL设计、验证、测试流程。
2. 熟静态时序分析。
3. 熟 AMBA 总线协议。
4. 熟 eMMC/PCIe/NVMe协议或NAND Flash 控制者优先。
5. 搭建FPGA平台并配合应用工程师完成芯片的系统级验证。

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